标准:ethernet:mdio:start

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--- 标准:ethernet:mdio:start [2024/12/13 09:10] – [参考文献] hwwiki
+++ 标准:ethernet:mdio:start [2024/12/26 08:26] (当前版本) – [原理图设计] hwwiki
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 ===== Electrical Characteristics =====
-MIDIO时序的要求每个芯片差异较大，具体以芯片规格书为准，示例如下：
+[[https://pan.baidu.com/s/1l85JIkK0asD6NAqfN7V4ig |802.3]] 45.4.2或22.3.4定义的时序要求如下：
-{{:标准:ethernet:mdio:mdc-mdio_timing.png?600|}}
+{{:标准:ethernet:mdio:mdio_time.png?600|}}
-===== 原理图设计 =====
+除了满足协议的要求外，MIDIO时序的要求各芯片差异较大，具体以芯片规格书为准，示例如下：
-协议802.3 建议MDIO进行下拉（下拉电阻建议为2k欧姆+5%），和上拉（上拉电阻建议为1.5k欧姆+5%），使得在TA时，MDIO处于中间态即Z状态。但不是每个芯片都有次要求，具体详见芯片规格书或其参考设计。MDC一般无上下拉的要求。
+图中的MDIO（Output）指Sourced by STA（MAC），MDIO（Input）指Sourced by MMD（PHY）。
-MDIO电平一般有1.8V和3.3V两种，MAC和PHY如果电平不同，则需要加电平转换电路。其时钟为MHz，三极管或MOS管的电平转换电路不满足此频率要求，需要用专门的转换芯片。TI提供的电平转换芯片见文档“{{ :元器件:ic:logic:translators_level-shifters:ti_voltage_translation_buying_guide.pdf | Voltage Translation Buying Guide}}”
+{{:标准:ethernet:mdio:mdc-mdio_timing.png?600|}}
+===== 原理图设计 =====
+  - **上下拉电阻**：协议802.3 建议MDIO进行下拉（下拉电阻建议为2k欧姆+5%），和上拉（上拉电阻建议为1.5k欧姆+5%），使得在TA时，MDIO处于中间态即Z状态。但不是每个芯片都有次要求，具体详见芯片规格书或其参考设计。MDC一般无上下拉的要求。
+  - **电平转换**：MDIO电平一般有1.8V和3.3V两种，MAC和PHY如果电平不同，则需要加电平转换电路。其时钟为MHz，三极管或MOS管的电平转换电路不满足此频率要求，需要用专门的转换芯片。TI提供的电平转换芯片见文档“{{ :元器件:ic:logic:translators_level-shifters:ti_voltage_translation_buying_guide.pdf | Voltage Translation Buying Guide}}”
+  - **地址**：如果同一总线上挂载了多个设备，则各设备的地址应不同。
-===== PCB设计 =====
-MDC和MDIO推荐阻抗各控制50Ω，两者之间间距大于2倍线宽（两者不是差分线，间距不能太小，否则串扰大），一般无等长控制要求，满足时序要求即可。
-MDC是时钟，注意和其他线隔离。
+===== PCB设计 =====
+  - **阻抗**：MDC和MDIO单端阻抗50Ω；
+  - **间距**：两倍线宽（两者不是差分线，间距不能太小，否则串扰大）
+  - **等长**：无严格等长要求，推荐±2mm。
 ===== 参考文献 =====
-[[https://blog.chinaaet.com/justlxy/p/5100064818|以太网扫盲——SMI（MDC/MDIO）介绍]]
+  - [[https://blog.chinaaet.com/justlxy/p/5100064818|以太网扫盲——SMI（MDC/MDIO）介绍]]
+  - {{ :标准:ethernet:mdio:mdiomasterandslavecontrollersdocumentation.pdf | Lattice, RD1194, MDIO Master and Slave Controllers User Guide}}

标准/ethernet/mdio/start.1734052238.txt.gz · 最后更改: 2024/12/13 09:10 由 hwwiki